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対症療法としてはRAMなんだから物理アドレスをスクランブルすればよいとは思うがそのコストが(非常に)問題だなぁ。ソフトじゃ無理だなぁ(仮想アドレッシングで逃げられるほどの粒度ならあるいは)既存のハードでは対処のしようが無いし新しいチップセットにはこの対策が含まれるようになるのだろうか。しかし、メモリメーカでもあらかじめわかると思うんだけど東芝FDD訴訟みたいに欠陥だとして訴えられたらwktk
具体的な対策は
A.これを発表した研究者の元に行き、具体的詳細を聞いてその研究者に多額の研究費を寄付し研究させ、出てきた情報を弁護士に多額の費用を払って賠償請求訴訟を起こして世間に問題を喚起、悪辣非道の手抜きメーカに正義の鉄拳を喰らわせると共に、問題の製品を回収させるか、緩和対策をメーカの責任でさせる事で、世界の平和を守る正義のヒーローになる。
B.よくこんなのはっけんしたね!すごいね! さすが!って感嘆し、あくようされたらこわいね、こわいね!って震えるなど、スラドで馬鹿話をした後、飯を食って風呂入ってアイス食ってクソして寝る
このどちらかかな
風呂でうんこすんな
その2択なら絶対Bだろ。何択だろうがAは絶対選ばれることのない、いわば選択肢もどきだから。
WindowsならEMET [microsoft.com]で撃墜できんかな
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人生unstable -- あるハッカー
非リニア化 (スコア:0)
対症療法としては
RAMなんだから物理アドレスをスクランブルすればよいとは思うが
そのコストが(非常に)問題だなぁ。ソフトじゃ無理だなぁ
(仮想アドレッシングで逃げられるほどの粒度ならあるいは)
既存のハードでは対処のしようが無いし
新しいチップセットにはこの対策が含まれるようになるのだろうか。
しかし、メモリメーカでもあらかじめわかると思うんだけど
東芝FDD訴訟みたいに欠陥だとして訴えられたらwktk
Re:非リニア化 (スコア:1)
RAMなんかのセル配置は二次元に並んでいますが
実際には、レイアウト上の都合や色々な最適化の結果、
仕様書上のアドレス端子をリニアにX-Yに振ったセル配置にはなりません
なので、CPUからリニアにアクセスしても隣接セルが連続でアクセスされる保証はないです
もちろん、データ線に関しても同様で、同一アドレスのD0、D1が隣接するセルとは限りません
さらに、小容量メモリを除くと、スペアブロックとの置換処理(救済処理)なんかも入りますので、さらに・・・
ちなみに、製造過程のテストではそれらの内部設計仕様書使って、物理的に隣接したセルを意識したテストをします
>東芝FDD訴訟みたいに欠陥だとして訴えられたらwktk
仕様書と異なる動作なら、不良、もしくは欠陥
仕様外の条件で発生しているのであれば、使用上の問題ですね
Re: (スコア:0)
具体的な対策は
A.これを発表した研究者の元に行き、具体的詳細を聞いてその研究者に多額の研究費を寄付し研究させ、出てきた情報を弁護士に多額の費用を払って賠償請求訴訟を起こして世間に問題を喚起、悪辣非道の手抜きメーカに正義の鉄拳を喰らわせると共に、問題の製品を回収させるか、緩和対策をメーカの責任でさせる事で、世界の平和を守る正義のヒーローになる。
B.よくこんなのはっけんしたね!すごいね! さすが!って感嘆し、あくようされたらこわいね、こわいね!って震えるなど、スラドで馬鹿話をした後、飯を食って風呂入ってアイス食ってクソして寝る
このどちらかかな
Re: (スコア:0)
風呂でうんこすんな
Re: (スコア:0)
その2択なら絶対Bだろ。
何択だろうがAは絶対選ばれることのない、いわば選択肢もどきだから。
Re: (スコア:0)
WindowsならEMET [microsoft.com]で撃墜できんかな