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対症療法としてはRAMなんだから物理アドレスをスクランブルすればよいとは思うがそのコストが(非常に)問題だなぁ。ソフトじゃ無理だなぁ(仮想アドレッシングで逃げられるほどの粒度ならあるいは)既存のハードでは対処のしようが無いし新しいチップセットにはこの対策が含まれるようになるのだろうか。しかし、メモリメーカでもあらかじめわかると思うんだけど東芝FDD訴訟みたいに欠陥だとして訴えられたらwktk
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普通のやつらの下を行け -- バッドノウハウ専門家
非リニア化 (スコア:0)
対症療法としては
RAMなんだから物理アドレスをスクランブルすればよいとは思うが
そのコストが(非常に)問題だなぁ。ソフトじゃ無理だなぁ
(仮想アドレッシングで逃げられるほどの粒度ならあるいは)
既存のハードでは対処のしようが無いし
新しいチップセットにはこの対策が含まれるようになるのだろうか。
しかし、メモリメーカでもあらかじめわかると思うんだけど
東芝FDD訴訟みたいに欠陥だとして訴えられたらwktk
Re:非リニア化 (スコア:1)
RAMなんかのセル配置は二次元に並んでいますが
実際には、レイアウト上の都合や色々な最適化の結果、
仕様書上のアドレス端子をリニアにX-Yに振ったセル配置にはなりません
なので、CPUからリニアにアクセスしても隣接セルが連続でアクセスされる保証はないです
もちろん、データ線に関しても同様で、同一アドレスのD0、D1が隣接するセルとは限りません
さらに、小容量メモリを除くと、スペアブロックとの置換処理(救済処理)なんかも入りますので、さらに・・・
ちなみに、製造過程のテストではそれらの内部設計仕様書使って、物理的に隣接したセルを意識したテストをします
>東芝FDD訴訟みたいに欠陥だとして訴えられたらwktk
仕様書と異なる動作なら、不良、もしくは欠陥
仕様外の条件で発生しているのであれば、使用上の問題ですね